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Mensaje |
pinus
Nivel 4
Edad: 36
Registrado: 20 Ene 2009
Mensajes: 100
Carrera: Informática, Sistemas y
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Se dispone de chips de memoria de 1GB, 512MB y 256MB. Utilizar al menos uno de cada tipo para implementar la memoria principal de una arquitectura ARC.
Proponer una solución con decodificadores y otra con compuertas.
Para completar los 4GB voy a usar, en este orden, tres bloques de 1GB, uno de 512MB y dos de 256MB.
Primer bloque de un 1GB:
Primera dirección: 0000 0000 0000 0000 0000 0000 00000 0000 = 0x00000000
Ultima dirección: 0011 1111 1111 1111 1111 1111 1111 1111 = 0x2FFFFFFF
Segundo bloque de un 1GB:
Primera dirección: 0100 0000 0000 0000 0000 0000 00000 0000 = 0x40000000
Ultima dirección: 0111 1111 1111 1111 1111 1111 1111 1111 = 0x7FFFFFFF
Tercer bloque de un 1GB:
Primera dirección: 1000 0000 0000 0000 0000 0000 00000 0000 = 0x80000000
Ultima dirección: 1011 1111 1111 1111 1111 1111 1111 1111 = 0xBFFFFFFF
Cuarto bloque de un 512 MB:
Primera dirección: 1100 0000 0000 0000 0000 0000 00000 0000 = 0xC0000000
Ultima dirección: 1101 1111 1111 1111 1111 1111 1111 1111 = 0xDFFFFFFF
Quinto bloque de un 256 MB:
Primera dirección: 1110 0000 0000 0000 0000 0000 00000 0000 = 0xE0000000
Ultima dirección: 1110 1111 1111 1111 1111 1111 1111 1111 = 0xEFFFFFFF
Sexto bloque de un 256 MB:
Primera dirección: 1111 0000 0000 0000 0000 0000 00000 0000 = 0xF0000000
Ultima dirección: 1111 1111 1111 1111 1111 1111 1111 1111 = 0xFFFFFFFF
Para la entrada de los CS:
Para el primer bloque de 1GB: ~A31* ~A30
Para el segundo bloque de 1GB: ~A31*A30
Para el tercer bloque de 1GB: A31* ~A30
Para el cuarto bloque de 512 MB: A31*A30* ~A29
Para el quinto bloque de 256MB: A31*A30*A29* ~A28
Para el sexto bloque de 256MB: A31*A30*A29*A28
Mas tarde subo lo que se me ocurrio para diseñarlo primero con compuertas (varias ands y nands) y despues con decodificadores.
Espero sugerencias, creo que es el primer ejercicio de memorias que hago completo.
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pinus
Nivel 4
Edad: 36
Registrado: 20 Ene 2009
Mensajes: 100
Carrera: Informática, Sistemas y
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Bueno agrego el dibujo de la memoria con DECOS.
Un par de cuestiones que omiti por simplicidad al momento de dibujar
Todas las entradas y salidas deberían compartirse entre los chips de memoria. Y en vez de dibujar 32 cables ...a veces se aclara que el cable vale por 32 ...jeje La idea del enunciado era dibujar todas las entradas y salidas que tiene la memoria principal en la figura 6.10 del murdocca (no estoy muy seguro de la forma en que yo las dibuje).
Los Decos que puse deberían asegurar que se acceda a un unico chip por vez con lo cual es seguro unir todas las entradas y salidas.
[img]http://www.mediafire.com/imageview.php?quickkey=4ayww8714148uez[/img]
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fumancho
Nivel 2
Registrado: 02 Nov 2010
Mensajes: 5
Carrera: Agrimensura, Alimentos, Civil, Electricista, Electrónica, Industrial, Informática, Mecánica, Naval, Química y Sistemas
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| pinus escribió:
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Se dispone de chips de memoria de 1GB, 512MB y 256MB. Utilizar al menos uno de cada tipo para implementar la memoria principal de una arquitectura ARC.
Proponer una solución con decodificadores y otra con compuertas.
Para completar los 4GB voy a usar, en este orden, tres bloques de 1GB, uno de 512MB y dos de 256MB.
Primer bloque de un 1GB:
Primera dirección: 0000 0000 0000 0000 0000 0000 00000 0000 = 0x00000000
Ultima dirección: 0011 1111 1111 1111 1111 1111 1111 1111 = 0x2FFFFFFF
Segundo bloque de un 1GB:
Primera dirección: 0100 0000 0000 0000 0000 0000 00000 0000 = 0x40000000
Ultima dirección: 0111 1111 1111 1111 1111 1111 1111 1111 = 0x7FFFFFFF
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Creo que te equivocaste en la ultima direccion del primer bloque, deberia ser 0x3FFFFFFF
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